版主: Jeff, Korping_Chang
狩野 寫:以下淺見 , 提供參考架構 , 每一種我都會 TEST 無誤且聲音有超水準表現時會公佈給此處網友 diy 自製 , 我想這樣才是負責任的 diy 態度 , 也才是真正追求的 "音響魂" 的表現.
要升級CD PRO2有幾種方法:
A.架構為:CD PRO2 I2S->FIFO->DIT4192或CS8406-> 多工器->RCA/BNC/平衡/光纖數位輸出
B.架構為:CD PRO2 SPDIF->FIFO-> 多工器->RCA/BNC/平衡/光纖數位輸出
不過我認為這樣升級的意義不大(個人意見),提升的效果也是不會顯著的.
我想的是徹底的升級,架構為:
(A) .CS8406工作在硬模式:
CD PRO2 I2S->FIFO->CS8421->CS8406->
CD PRO2 SPDIF->
多工器->RCA/BNC/平衡/光纖數位輸出
(B) .CS8406工作在軟體模式:
CD PRO2 I2S->FIFO->CS8421->CS8406->
CD PRO2 SPDIF->
多工器->RCA/BNC/平衡/光纖數位輸出
這二種結構的輸出都可以相容48/96/192kHz的解碼器.
(C). CS8406工作在硬模式或軟體模式:
CD PRO2 I2S
CD PRO2 SPDIF-> CS8416
多工器->FIFO->CS8421->CS8406-> 多工器->RCA/BNC/平衡/光纖數位輸出
這種結構的輸出只能用192kHz的解碼器.
(D).CD PRO2 I2S->FIFO->CS8421->FIFO->PCM1794->LPF+升壓變壓器輸出類比信號(RCA/平衡)
低噪音線性並聯穩壓電源
高精度超低抖動時鐘源(0.05ppm)
(E).CD PRO2 I2S->FIFO->CS8421->FIFO->PCM1794->LPF+真空管+變壓器輸出類比信號(RCA/平衡)
低噪音線性並聯穩壓電源
高精度超低抖動時鐘源(0.05ppm)
(F).CD PRO2 I2S->FIFO->CS8421->FIFO->PCM1794->LPF+電晶體橋式輸出類比信號(RCA/平衡)
低噪音線性並聯穩壓電源
高精度超低抖動時鐘源(0.05ppm)
(G)、(H)、(I) PCM1794可以二、四、八、十六片並聯起來使用
這幾種結構可以使CS8421、PCM1794工作在超頻狀態,採樣率可以提升到200kHz-250kHz。同時這個高精度超低抖動時鐘源可以為CD PRO2提供工作時鐘。我比較傾向於採用架構( D),只是將PCM1794二片或四片並聯起來使用。
以上是提供參考 , 不是在推銷東西 , 各位網友別誤會 !
Erwin Tseng 提出的這架構很好呀,但CS8416應該為CS8406,只不過後面的解碼器不能用44.1/48/96kHz的,僅僅能夠用192kHz, 以上僅供參考.Erwin Tseng 寫:狩野 寫:以下淺見 , 提供參考架構 , 每一種我都會 TEST 無誤且聲音有超水準表現時會公佈給此處網友 diy 自製 , 我想這樣才是負責任的 diy 態度 , 也才是真正追求的 "音響魂" 的表現.
要升級CD PRO2有幾種方法:
A.架構為:CD PRO2 I2S->FIFO->DIT4192或CS8406-> 多工器->RCA/BNC/平衡/光纖數位輸出
B.架構為:CD PRO2 SPDIF->FIFO-> 多工器->RCA/BNC/平衡/光纖數位輸出
我以前在音響 EZ 通問過 Dream_Reader 前輩有關 de-jitter 線路的問題, 其回覆如下:
接收IC前加FIFO-->無效
數位接收IC 及 DAC 間加入 ASRC 和 TXCO-->有幫助
數位接收IC 及 DAC 間加入 FIFO 和 TXCO -->最佳
也就是說 spdif 加 FIFO 對 de-jitter 沒多大幫助......
竊以為若是把 cd-pro2 作為純轉盤的情況下, 個人比較傾向:
______ WS ___ ___ ___ ___ DO
| |---->|8|->|F|->|8| |多|->IU
|SAA |SDATA|4| |I| |4| SPDIF | |->GT
|7XXX|---->|2|->|F|->|1|------>|工|->IP
| |BCLK |1| |O| |6| | |->TU
| |---->| |->| |->| | |器|->AT
------ --- --- --- --- L
︿ ︿ ︿ ︿
| _______ | MCK|
-<(除頻)-|CLOCK|>-->---
-------
不過我認為這樣升級的意義不大(個人意見),提升的效果也是不會顯著的.
我想的是徹底的升級,架構為:
(A) .CS8406工作在硬模式:
CD PRO2 I2S->FIFO->CS8421->CS8406->
CD PRO2 SPDIF->
多工器->RCA/BNC/平衡/光纖數位輸出
(B) .CS8406工作在軟體模式:
CD PRO2 I2S->FIFO->CS8421->CS8406->
CD PRO2 SPDIF->
多工器->RCA/BNC/平衡/光纖數位輸出
這二種結構的輸出都可以相容48/96/192kHz的解碼器.
(C). CS8406工作在硬模式或軟體模式:
CD PRO2 I2S
CD PRO2 SPDIF-> CS8416
多工器->FIFO->CS8421->CS8406-> 多工器->RCA/BNC/平衡/光纖數位輸出
這種結構的輸出只能用192kHz的解碼器.
(D).CD PRO2 I2S->FIFO->CS8421->FIFO->PCM1794->LPF+升壓變壓器輸出類比信號(RCA/平衡)
低噪音線性並聯穩壓電源
高精度超低抖動時鐘源(0.05ppm)
(E).CD PRO2 I2S->FIFO->CS8421->FIFO->PCM1794->LPF+真空管+變壓器輸出類比信號(RCA/平衡)
低噪音線性並聯穩壓電源
高精度超低抖動時鐘源(0.05ppm)
(F).CD PRO2 I2S->FIFO->CS8421->FIFO->PCM1794->LPF+電晶體橋式輸出類比信號(RCA/平衡)
低噪音線性並聯穩壓電源
高精度超低抖動時鐘源(0.05ppm)
(G)、(H)、(I) PCM1794可以二、四、八、十六片並聯起來使用
這幾種結構可以使CS8421、PCM1794工作在超頻狀態,採樣率可以提升到200kHz-250kHz。同時這個高精度超低抖動時鐘源可以為CD PRO2提供工作時鐘。我比較傾向於採用架構( D),只是將PCM1794二片或四片並聯起來使用。
以上是提供參考 , 不是在推銷東西 , 各位網友別誤會 !
Erwin Tseng 提出的這架構很好呀,但CS8416應該為CS8406,只不過後面的解碼器不能用44.1/48/96kHz的,僅僅能夠用192kHz, 以上僅供參考.[/quote]狩野 寫:
這位高手說的有一定道理,這主要看是怎樣並聯了,簡簡單單的並聯起來是有一定的風險,但是只要把介面電路匹配好是沒有什麼問題的。超頻工作後中高頻會好一些,超頻工作是要有條件的,在應用上會有一些技巧。這有一點類似於電腦的CPU超頻。番薯寶寶 寫:小弟並不贊成讓晶片超頻工作~200K或250K等
規格會定44.1K/48K/88.2K/96K/192K這些頻率一定有他的理由~
如果工作在200K或250K~則無法得知對聲音的影響為何~
而且晶片要超頻工作也要看運氣~並不是每一顆都可以在此頻率工作
在製程上~由於生產過程手續繁複~每顆晶片的特性都不可能一模一樣
就像BJT~相同批號甚至同一塊晶圓上出來的hfe可以相差甚遠~
所以手續繁複的晶片就更不用奢望他們會有雙胞胎或多胞胎~
而且並聯的情況~會使得晶片的輸出阻抗等等的特性相對改變~
萬一甲晶片的輸出比乙晶片多那麼0.0001V~那情況為何?
晶片並聯讓小弟想起了"圖騰柱效應"~兩個輸出級並聯~
結果不是你死~就是我亡~但是死了都沒有兆頭~安靜無聲
所以或許晶片並聯~會唱歌~但是時間一久~晶片有陣亡的也不知道
反正有備用的繼續唱歌~就算剩一個也會唱歌~
以數位的觀點來看~輸入是可以並聯的~但輸出就不一定了
以TTL而言~只有開集極的型號可以並聯~
目前的CMOS或BiCMOS製程~其輸出電路結構種類繁多
CMOS製程的數位輸出通常都會加上Buffer~為了就是要推的動後續的大電容負載[晶片打線...PAD接點...邏輯閘輸入]
典型的Buffer就是兩個反向器組合而成~使用兩個PMOS兩個NMOS
假如這是晶片的數位輸出~而類比輸出通常都是OP[簡單或複雜]
這種情況就不是每種晶片都給他來並聯~
試想看看~大家敢不敢把兩個前級或後級給它直接並聯輸出?這是一樣的道理~
除了原廠公佈此晶片可以並聯使用~不然小弟是不會冒險去玩並聯
或許小弟本身走晶片設計~對於這方面稍有涉略~雖然主要擅長是HDL設計~但晶片設計也是有涉略
把數位電路細看~拆開看一樣還是類比電路~
玩晶片並聯~小弟認為"要三思"
數位電路與類比電路不同,超頻影響不大.我在這番薯寶寶 寫:把供應給ASRC的時脈提高就等於是超頻了~
如果都以256Fs為準~
44.1K => 11.2896Mhz
48K => 12.288Mhz
88.2K => 22.5792Mhz
96K => 24.576Mhz
192K => 49.152Mhz
所以如果想要讓ASRC工作在200K下~時脈就必須給51.2Mhz~以此類推~
一般的接收晶片~如果是用硬式的方式操控~預設值都是256Fs輸出~也就是MCK的頻率~
所以如果把框頁數提高~則等於在相同時間內讓DAC內部的濾波器能夠接收到更多的訊息~自然對聲音會有正面的幫助
但頻率會變高~除了相對應的石英頻率難找外~實用性也是一大問題
番薯寶寶 寫:在製程上~由於生產過程手續繁複~每顆晶片的特性都不可能一模一樣
就像BJT~相同批號甚至同一塊晶圓上出來的hfe可以相差甚遠~
所以手續繁複的晶片就更不用奢望他們會有雙胞胎或多胞胎~
而且並聯的情況~會使得晶片的輸出阻抗等等的特性相對改變~
萬一甲晶片的輸出比乙晶片多那麼0.0001V~那情況為何?
晶片並聯讓小弟想起了"圖騰柱效應"~兩個輸出級並聯~
結果不是你死~就是我亡~但是死了都沒有兆頭~安靜無聲
所以或許晶片並聯~會唱歌~但是時間一久~晶片有陣亡的也不知道
反正有備用的繼續唱歌~就算剩一個也會唱歌~
以數位的觀點來看~輸入是可以並聯的~但輸出就不一定了
以TTL而言~只有開集極的型號可以並聯~
目前的CMOS或BiCMOS製程~其輸出電路結構種類繁多
CMOS製程的數位輸出通常都會加上Buffer~為了就是要推的動後續的大電容負載[晶片打線...PAD接點...邏輯閘輸入]
典型的Buffer就是兩個反向器組合而成~使用兩個PMOS兩個NMOS
假如這是晶片的數位輸出~而類比輸出通常都是OP[簡單或複雜]
這種情況就不是每種晶片都給他來並聯~
試想看看~大家敢不敢把兩個前級或後級給它直接並聯輸出?這是一樣的道理~
ijaywu 寫:番薯寶寶 寫:在製程上~由於生產過程手續繁複~每顆晶片的特性都不可能一模一樣
就像BJT~相同批號甚至同一塊晶圓上出來的hfe可以相差甚遠~
所以手續繁複的晶片就更不用奢望他們會有雙胞胎或多胞胎~
而且並聯的情況~會使得晶片的輸出阻抗等等的特性相對改變~
萬一甲晶片的輸出比乙晶片多那麼0.0001V~那情況為何?
晶片並聯讓小弟想起了"圖騰柱效應"~兩個輸出級並聯~
結果不是你死~就是我亡~但是死了都沒有兆頭~安靜無聲
所以或許晶片並聯~會唱歌~但是時間一久~晶片有陣亡的也不知道
反正有備用的繼續唱歌~就算剩一個也會唱歌~
以數位的觀點來看~輸入是可以並聯的~但輸出就不一定了
以TTL而言~只有開集極的型號可以並聯~
目前的CMOS或BiCMOS製程~其輸出電路結構種類繁多
CMOS製程的數位輸出通常都會加上Buffer~為了就是要推的動後續的大電容負載[晶片打線...PAD接點...邏輯閘輸入]
典型的Buffer就是兩個反向器組合而成~使用兩個PMOS兩個NMOS
假如這是晶片的數位輸出~而類比輸出通常都是OP[簡單或複雜]
這種情況就不是每種晶片都給他來並聯~
試想看看~大家敢不敢把兩個前級或後級給它直接並聯輸出?這是一樣的道理~
前、後級不能並聯是因為輸出阻抗小,輸出的電壓如果有差距,造成的誤差電流可能不小。特別是後級。
pcm1794是differential current output(高檔的DAC 都是這樣啦),所謂的current output輸出阻抗應該頗高。理論上,不會有這個燒機的問題。但好不好?說老實話,我不知道。
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